Takt aperiodisch
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I²C-Übertragung (Ausschnitt: Startbedingung und Adressierung), der per Bitbanging steuernde Prozessor behandelt nach dem dritten Bit einen Interrupt.
Unten das aperiodische Taktsignal bei einer I²C-Übertragung (zu sehen ist der Beginn mit der Startbedingung (markiert mit einem grünen Punkt) und der Adressierung inkl. Acknowledge; die obere Wellenform stellt das Datensignal dar, die untere das Taktsignal). Das Taktsignal besteht nur aus einer passenden Anzahl von Taktzyklen. Das Übertragungsprotokoll wird durch Software gesteuert (Bitbanging); der steuernde Prozessor behandelt hier im Beispiel einen zufällig nach dem dritten Bit aufgetretenen Interrupt, wodurch sich eine Verzögerung der Übertragung (hier um etwa 70 µs) ergibt. Da Daten- und Taktsignal dennoch synchron zueinander bleiben, handelt es sich um ein vollkommen legitimes und gültiges I²C-Signal.
Unten das aperiodische Taktsignal bei einer I²C-Übertragung (zu sehen ist der Beginn mit der Startbedingung (markiert mit einem grünen Punkt) und der Adressierung inkl. Acknowledge; die obere Wellenform stellt das Datensignal dar, die untere das Taktsignal). Das Taktsignal besteht nur aus einer passenden Anzahl von Taktzyklen. Das Übertragungsprotokoll wird durch Software gesteuert (Bitbanging); der steuernde Prozessor behandelt hier im Beispiel einen zufällig nach dem dritten Bit aufgetretenen Interrupt, wodurch sich eine Verzögerung der Übertragung (hier um etwa 70 µs) ergibt. Da Daten- und Taktsignal dennoch synchron zueinander bleiben, handelt es sich um ein vollkommen legitimes und gültiges I²C-Signal.
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(c) Rico Shen, CC BY-SA 3.0
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